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Title: Gerador de sinal PWM utilizando múltiplos recortes.
Other Titles: PWM signal generator using multiple cutouts.
???metadata.dc.creator???: BARROS, Luciano de Macedo.
???metadata.dc.contributor.advisor1???: OLIVEIRA, Alexandre Cunha.
Keywords: Gerador de sinal PWM;Modulação por largura de pulso;Pulse Width Modulation;Síntese lógica Quartus II;VERILOG;Linguagem Verilog;Dispositivo FPGA;PWM signal generator;Logical synthesis Quartus II;Verilog Language;FPGA device
Issue Date: Jun-2009
Publisher: Universidade Federal de Campina Grande
Citation: BARROS, Luciano de Macedo. Gerador de sinal PWM utilizando múltiplos recortes. 2009. 56f. Curso de Bacharelado em Engenharia Elétrica, Centro de Engenharia Elétrica e Informática , Universidade Federal de Campina Grande – Paraíba Brasil, 2019. Disponível em: http://dspace.sti.ufcg.edu.br:8080/jspui/handle/riufcg/17289
???metadata.dc.description.resumo???: Neste trabalho será apresentado um gerador de sinais PWM implementado a partir de um dispositivo FPGA contido na placa DE2 da ALTERA, utilizando a linguagem Verilog. Através da técnica desenvolvida, é possível garantir sinais PWM com alta resolução e também gerar padrões PWM com múltiplos pulsos em um mesmo período do sinap PWM. Com esta técnica é possível atender aos requisitos de geração de sinais de sistemas hexafásicos, sem restrições de sequência de chaveamento, bem como gerar sinais com rebatimento de pulsos, sem que seja necessário diminuir a frequência de chaveamento.
Keywords: Gerador de sinal PWM
Modulação por largura de pulso
Pulse Width Modulation
Síntese lógica Quartus II
VERILOG
Linguagem Verilog
Dispositivo FPGA
PWM signal generator
Logical synthesis Quartus II
Verilog Language
FPGA device
???metadata.dc.subject.cnpq???: Engenharia Elétrica.
URI: http://dspace.sti.ufcg.edu.br:8080/jspui/handle/riufcg/17289
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