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  3. PÓS-GRADUAÇÃO EM ENGENHARIA ELÉTRICA
  4. Mestrado em Engenharia Elétrica.
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dc.creator.IDNEVES, W. L. A.pt_BR
dc.creator.Latteshttp://lattes.cnpq.br/3107104665517286pt_BR
dc.contributor.advisor1NAIDU, Sreeramulu Raghuram.-
dc.contributor.advisor1IDNAIDU, S. R.pt_BR
dc.contributor.advisor1Latteshttp://lattes.cnpq.br/1635797379532528pt_BR
dc.description.resumoO objetivo deste estudo foi similar a resposta degrau de um sistema de medição que utiliza o divisor de potencial capacitivo do laboratório de Alata Tenão (LAT) da UFPB, e comparar os resultados com as medições da resposta degrau. O arranjo em quadratura foi usado no posicionamento do cabo de alta tensão. Dois modelos foram utilizados para representar as capacitâncias parasitas do divisor de potencial. O primeiro foi sugerido pelo Grupo de Estudos IRR-IMS ( International Research-Group Renardieres on Impulse Measuring Systems) e o segunso pelo LAT da UFPB. A resposta degrau medida. Há maior aproximação entre simulação e medição se forem também incluídas as perdas e as indutâncias residuais do divisor.pt_BR
dc.publisher.countryBrasilpt_BR
dc.publisher.departmentCentro de Engenharia Elétrica e Informática - CEEIpt_BR
dc.publisher.programPÓS-GRADUAÇÃO EM ENGENHARIA ELÉTRICApt_BR
dc.publisher.initialsUFCGpt_BR
dc.subject.cnpqEngenharia Elétrica-
dc.titleResposta degrau de um divisor de potencial capacitivo.pt_BR
dc.date.issued1982-02-
dc.description.abstractThe objective of this study was similar to the step response of a measurement system that uses the capacitive potential divider of the UFPB Alata Tenão laboratory (LAT), and to compare the results with the step response measurements. The quadrature arrangement was used in the positioning of the high voltage cable. Two models were used to represent the parasitic capacitors of the potential divider. The first was suggested by the IRR-IMS Study Group (International Research Group Renardieres on Impulse Measuring Systems) and the second by the UFPB LAT. The response step measured. Simulation and measurement are better approximated if the divider losses and residual inductances are also included.pt_BR
dc.identifier.urihttp://dspace.sti.ufcg.edu.br:8080/jspui/handle/riufcg/8517-
dc.date.accessioned2019-10-25T17:33:19Z-
dc.date.available2019-10-25-
dc.date.available2019-10-25T17:33:19Z-
dc.typeDissertaçãopt_BR
dc.subjectResposta Degrau-
dc.subjectSistema de Medição-
dc.subjectTensão de Impulso-
dc.subjectMedição Elétrica-
dc.subjectDivisor de Potencial Capacitivo-
dc.subjectArranjo em Quadratura-
dc.subjectAnswer Step-
dc.subjectMeasuring System-
dc.subjectBoost Voltage-
dc.subjectElectrical Measurement-
dc.subjectCapacitive Potential Divider-
dc.subjectQuadrature Arrangement-
dc.rightsAcesso Abertopt_BR
dc.creatorNEVES, Washington Luís Araújo.-
dc.publisherUniversidade Federal de Campina Grandept_BR
dc.languageporpt_BR
dc.title.alternativeStep response of a capacitive potential divider.pt_BR
dc.identifier.citationNEVES, Washington Luís Araújo. Resposta degrau de um divisor de potencial capacitivo. 1982. 134f. (Dissertação) Mestrado em Engenharia Elétrica, Curso de Pós-Graduação em Engenharia Elétrica, Centro de Ciências e Tecnologia, Universidade Federal da Paraíba – Campus II - Campina Grande - Paraíba - Brasil, 1982.pt_BR
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