dc.creator.ID |
BRUNELLI, L. |
pt_BR |
dc.creator.Lattes |
http://lattes.cnpq.br/8019874133102405 |
pt_BR |
dc.contributor.advisor1 |
MELCHER, Elmar Uwe Kurt. |
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dc.contributor.advisor1 |
FREIRE, Raimundo Carlos Silvério. |
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dc.contributor.advisor1ID |
MELCHER, E. U. K. |
pt_BR |
dc.contributor.advisor1ID |
FREIRE, R. C. S. |
|
dc.contributor.advisor1Lattes |
http://lattes.cnpq.br/2995510206880397 |
pt_BR |
dc.contributor.advisor1Lattes |
http://lattes.cnpq.br/4016576596215504 |
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dc.contributor.referee1 |
BARROS, Edna Natividade da Silva. |
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dc.contributor.referee2 |
CAVALCANTI, José Homero Feitosa. |
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dc.contributor.referee3 |
STRUM, Marius. |
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dc.contributor.referee4 |
CATUNDA, Sebastian Yuri Cavalcanti. |
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dc.description.resumo |
Nesta tese descreve-se uma nova solução para o tratamento da complexidade das interconexões entre os elementos de processamento das redes neuronais artificiais (RNAs). Ela possibilita implementar RNAs em hardware, de tecnologia digital, com um número maior de neurônios do que se faz atualmente. As RNAs têm sido usadas como solução em vários problemas complexos. Em alguns destes problemas faz-se necesário a sua implementação em hardware. Vários s˜ao os compromissos que devem ser satisfeitos
durante o projeto e implementa¸c˜ao das RNAs, dentre eles o das interconexões entre
os neurônios. Atualmente encontram-se implementações neuronais utilizando circuitos
integrados especificamente desenvolvidos para uma dada arquitetura de rede neuronal e
também o uso de circuitos integrados configurados pelo usuário. Dentre estes circuitos
existem os FPGAs reconfigur´aveis dinamicamente (DR-FPGAs) que podem ter suas
características alteradas durante a sua opera¸c˜ao, sem sofrer interrupções em seu funcionamento normal. Estes dispositivos têm sido utilizados na implementação de RNAs.
Propõe-se uma solução para o problema das interconexões entre os neurônios artificiais
utilizando os DR-FPGAs e uma nova forma de computação: as Figuras de Execução
(F.E.). As F.E. permitem teoricamente reduzir o impacto das interconexões através da
eliminação do transporte de dados via barramento, além de outras vantagens e desvantagens durante o processamento da computação. As F.E. não parecem estar restritas apenas as aplicações de RNAs. Elas podem ser utilizadas pela computação reconfigurável em problemas massivamente paralelos e/ou que necessitem trocar informações entre os vários elementos de processamento do sistema. |
pt_BR |
dc.publisher.country |
Brasil |
pt_BR |
dc.publisher.department |
Centro de Engenharia Elétrica e Informática - CEEI |
pt_BR |
dc.publisher.program |
PÓS-GRADUAÇÃO EM ENGENHARIA ELÉTRICA |
pt_BR |
dc.publisher.initials |
UFCG |
pt_BR |
dc.subject.cnpq |
Engenharia Elétrica. |
pt_BR |
dc.title |
Abordagem para redução de complexidade de RNA usando reconfiguração dinâmica. |
pt_BR |
dc.date.issued |
2005-02 |
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dc.description.abstract |
In this thesis a new solution for the treatment of the complexity in the interconnections
among the processing elements of the artificial neural networks (ANNs) is
described. It enables realize ANNs digital hardware implementation with a larger number
of neurons than does nowadays. The ANNs have been used as a solution in various
complex problems. Some of these problems require hardware implementation. A lot of
constraints must be satisfied during the project flow of the implementations of ANNs,
such as the neural interconnections. Nowadays, neural implementations are done using
integrated circuits, specifically developed for a given neural network architecture or
integrated circuits configured by the user. Among these circuits exist the dynamically
reconfigured FPGAs (DR-FPGAs) which can have their characteristics changed during
operation without suffering interruptions in their execution. These devices have been
usedforANNimplementations. Itpresentsaproposaltosolvethe interconnection problem
for artificial neurons using DR-FPGAs in a new computational way: the Execution
Patterns1 (EPs). The EPs allow, theoretically, to reduce the influence of interconnections
through the removal of data transport via busses, besides other advantages and
disadvantages. TheEPsdoesnotseemtoberestrictedonlytoANNapplications. They
can be used by reconfigurable computation in massive parallel problems and/or problems
that demand information exchange among the various elements in a processing
system. |
pt_BR |
dc.identifier.uri |
http://dspace.sti.ufcg.edu.br:8080/jspui/handle/riufcg/1435 |
|
dc.date.accessioned |
2018-08-13T20:41:07Z |
|
dc.date.available |
2018-08-13 |
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dc.date.available |
2018-08-13T20:41:07Z |
|
dc.type |
Tese |
pt_BR |
dc.subject |
Rede neural |
pt_BR |
dc.subject |
Inteligência artificial. |
pt_BR |
dc.subject |
Neurociência computacional |
pt_BR |
dc.subject |
Computação reconfigurável |
pt_BR |
dc.subject |
VLSI |
pt_BR |
dc.subject |
FPGA |
pt_BR |
dc.subject |
Reconfiguração dinâmica |
pt_BR |
dc.subject |
Artificial Neural Networks |
pt_BR |
dc.subject |
Dynamic reconfiguration |
pt_BR |
dc.subject |
Chaveamento dinâmico de circuitos |
pt_BR |
dc.rights |
Acesso Aberto |
pt_BR |
dc.creator |
BRUNELLI, Luiz. |
|
dc.publisher |
Universidade Federal de Campina Grande |
pt_BR |
dc.language |
por |
pt_BR |
dc.title.alternative |
Approach for complexity reduction of ANN using dynamic reconfiguration. |
pt_BR |
dc.description.sponsorship |
CNPq |
pt_BR |
dc.identifier.citation |
BRUNELLI, Luiz. Abordagem para redução de complexidade de RNA usando reconfiguração dinâmica. 2005. 184f. (Tese de Doutorado em Engenharia Elétrica), Programa de Pós-graduação em Engenharia Elétrica, Centro de Engenharia Elétrica e Informática, Universidade Federal de Campina Grande - Paraíba - Brasil, 2005. |
pt_BR |