Relatório de estágio - Interest Engenharia LTDA.

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Curso de Bacharelado em Engenharia Elétrica - CEEI - Relatórios de Estágio
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dc.creator.ID	PIMENTEL FILHO, E. P. X.	pt_BR
dc.creator.Lattes	http://lattes.cnpq.br/9779628722030523	pt_BR
dc.contributor.advisor1	GUERRA, Francisco das Chagas Fernandes.
dc.contributor.advisor1ID	GUERRA, F. C. F.	pt_BR
dc.contributor.referee1	FERREIRA, Tarso Vilela.
dc.contributor.referee1ID	FERREIRA, T. V.	pt_BR
dc.description.resumo	Este relatório de estágio integrado tem como objetivo fazer uma descrição, de maneira sucinta, das atividades desenvolvidas, experiências e aprendizados adquiridos durante o período na INTEREST Engenharia Ltda, desde o estudo de diagramas funcionais a atividade realizadas em campo. O trabalho esta organizado em cinco capítulos. O primeiro faz uma pequena descrição da empresa. O segundo faz um resumo sobre as atividades desenvolvidas no estágio. O terceiro contempla uma revisão de conhecimento essenciais para o desenvolvimento das atividades realizadas, descritas no capítulo quatro. O último capítulo contém as considerações finais.	pt_BR
dc.publisher.country	Brasil	pt_BR
dc.publisher.department	Centro de Engenharia Elétrica e Informática - CEEI	pt_BR
dc.publisher.initials	UFCG	pt_BR
dc.subject.cnpq	Engenharia Elétrica.	pt_BR
dc.title	Relatório de estágio - Interest Engenharia LTDA.	pt_BR
dc.date.issued	2014-11
dc.identifier.uri	http://dspace.sti.ufcg.edu.br:8080/jspui/handle/riufcg/19663
dc.date.accessioned	2021-06-28T17:37:50Z
dc.date.available	2021-06-28
dc.date.available	2021-06-28T17:37:50Z
dc.type	Trabalho de Conclusão de Curso	pt_BR
dc.subject	Estágio em Engenharia Elétrica	pt_BR
dc.subject	Interest Engenharia LTDA	pt_BR
dc.subject	Subestação elétrica	pt_BR
dc.subject	Relés digitais	pt_BR
dc.subject	Desenhos funcionais	pt_BR
dc.subject	Diagramas lógicos	pt_BR
dc.subject	Painéis de proteção - inspeção	pt_BR
dc.subject	Internship in Electrical Engineering	pt_BR
dc.subject	Interest Engenharia LTDA	pt_BR
dc.subject	Electrical substation	pt_BR
dc.subject	Digital relays	pt_BR
dc.subject	Functional drawings	pt_BR
dc.subject	Logic diagrams	pt_BR
dc.subject	Protection panels - inspection	pt_BR
dc.rights	Acesso Aberto	pt_BR
dc.creator	PIMENTEL FILHO, Eugenio Pachelle Xavier.
dc.publisher	Universidade Federal de Campina Grande	pt_BR
dc.language	por	pt_BR
dc.title.alternative	Internship report - Interest Engenharia LTDA.	pt_BR
dc.identifier.citation	PIMENTEL FILHO, Eugenio Pachelle Xavier. Relatório de estágio - Interest Engenharia LTDA. 2014. 33f. (Relatório de Estágio Integrado) Curso de Bacharelado em Engenharia Elétrica, Centro de Engenharia Elétrica e Informática, Universidade Federal de Campina Grande - Paraíba - Brasil, 2014. Disponível em: http://dspace.sti.ufcg.edu.br:8080/jspui/handle/riufcg/19663	pt_BR